CY29973AXI
IC FANOUT DIST 52TQFP
- 製品カテゴリ
- クロックジェネレータ、PLL、周波数シンセサイザ
- パッケージ
- 52-TQFP
- 在庫
- 3,471 pcs
- 供給状況
- 現在の数量は確認が必要です。
製品属性
| メーカー | Cypress Semiconductor Corp |
|---|---|
| 製品カテゴリ | クロックジェネレータ、PLL、周波数シンセサイザ |
| Differential - Input:Output | No/No |
| Divider/Multiplier | Yes/No |
| Frequency - Max | 125MHz |
| Input | PECL |
| Mounting Type | Surface Mount |
| Number of Circuits | 1 |
| Operating Temperature | -40°C ~ 85°C |
| Output | Clock |
| Package | Bulk |
| PLL | Yes with Bypass |
| Product status | Obsolete |
| Ratio - Input:Output | 4:12 |
| Supplier Device Package | 52-TQFP (10x10) |
| Type | Fanout Distribution, Multiplexer, Spread Spectrum Clock Generator, Zero Delay Buffer |
| Voltage - Supply | 2.9V ~ 3.6V |
| データシート | データシート PDF を表示 |
調達概要
CY29973AXI の主要な供給・購買情報です。
Antrex Electronicsを選ぶ理由
確認済みの調達、検査、国際調達要件に対して独立系ディストリビューションのサポートを提供します。
独立系ディストリビューションサポート
生産および調達要件に対応し、供給不足品、製造中止品、入手困難な電子部品の調達を支援します。
トレーサビリティ確認
注文確定前に、ラベル、ロット、デートコード、および利用可能なサプライチェーン書類を確認できます。
検査・試験
必要に応じて、外観検査、X線検査、第三者試験のサポートを手配できます。
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認証・検証サポート
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CY29973AXI の詳細説明
Product Overview
The Cypress Semiconductor Corp CY29973AXI is a surface-mount clock timing integrated circuit in a 52-TQFP (10x10) package. It combines fanout distribution, multiplexing, spread-spectrum clock generation, and zero-delay buffering in a single circuit. The device accepts PECL input and provides clock outputs, with a 4:12 input-to-output ratio and a maximum frequency rating of 125 MHz. It includes a PLL with bypass, supports division but not multiplication, operates from a 2.9 V to 3.6 V supply, and is specified for -40°C to 85°C.
Key Features
- Integrates fanout distribution, multiplexing, spread-spectrum clock generation, and zero-delay buffering functions.
- PECL input with clock output and a 4:12 input-to-output ratio.
- PLL with bypass and divider support, without multiplier support.
- Maximum frequency of 125 MHz.
- 2.9 V to 3.6 V supply and -40°C to 85°C operating temperature.
- 52-TQFP (10x10) surface-mount package.
Applications
- Distribution of clock signals from a PECL input source to multiple downstream timing paths.
- Multiplexing of clock paths within a single-circuit timing subsystem.
- Spread-spectrum clock generation in timing subsystems rated up to 125 MHz.
- Clock distribution paths that use zero-delay buffering from a PECL input to clock outputs.
Design & Procurement Notes
When selecting the CY29973AXI for a board design, confirm that the incoming clock source is PECL and that the downstream timing paths accept the provided clock outputs. The 4:12 ratio, single circuit count, and 125 MHz maximum frequency should be matched to the required fanout and timing budget. Because the device supports division but not multiplication, any frequency conversion must remain within the specified ratio and frequency rating. Layout should account for the 52-TQFP (10x10) surface-mount package, the 2.9 V to 3.6 V supply range, and the -40°C to 85°C operating temperature range.
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